崗位職責(zé)
1. 負(fù)責(zé)芯片頂層或IP集成驗(yàn)證;
2. 與設(shè)計(jì)人員共同制定驗(yàn)證規(guī)格和測(cè)試計(jì)劃,并搭建基于UVM的驗(yàn)證平臺(tái);
3. 執(zhí)行驗(yàn)證計(jì)劃,編寫測(cè)試用例,開展遞歸測(cè)試,完成問題的調(diào)試和修復(fù);
4. 負(fù)責(zé)覆蓋率收斂,并設(shè)計(jì)和編寫測(cè)試用例完成signoff前的Cross-check;
5. 開展門級(jí)功能和時(shí)序仿真。
任職要求:
1、3-5年邏輯驗(yàn)證經(jīng)驗(yàn),微電子、計(jì)算機(jī)、通信等相關(guān)專業(yè),碩士及以上學(xué)歷
2. 熟悉邏輯驗(yàn)證,具備豐富的IP/SOC驗(yàn)證經(jīng)驗(yàn);
3. 熟悉System Verilog和UVM驗(yàn)證方法學(xué);
4. 熟悉AXI/AHB/APB總線協(xié)議;
5. 熟悉以太網(wǎng)協(xié)議者優(yōu)先。
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